File:NOR gate layout.png
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NOR_gate_layout.png （600 × 433 像素，檔案大小：22 KB，MIME 類型：image/png）
摘要
| 描述 |
Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ |
| 日期 | 2009年11月20日 (原始上傳日期) |
| 來源 | 无法识别来源。根据版权声明推断为其自己的作品。 |
| 作者 | 无法识别作者。根据版权声明推断作者为Miquel puig。 |
授權條款
|
我，此作品的版權所有人，釋出此作品至公共領域。此授權條款在全世界均適用。 這可能在某些國家不合法，如果是的話： 我授予任何人有權利使用此作品於任何用途，除受法律約束外，不受任何限制。 |
檔案歷史
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| 日期/時間 | 縮圖 | 尺寸 | 用戶 | 備註 | |
|---|---|---|---|---|---|
| 目前 | 2009年11月20日 (五) 12:41 | | 600 × 433（22 KB） | Miquel puig | == Summary == Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ == Licensing == {{PD-self|date=November 2007}} Category:Logic Category:Logic gates |
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